關鍵詞：序列檢測器 moore電路 mealy電路 數字邏輯 

摘要：通過對傳統數字邏輯教材的序列檢測器設計的研究,指出工作時的輸出波形不合理,具體表現在待檢測序列最后一位信號出現但時鐘尚未有效時,檢測器已輸出檢測結果,合理波形應該是待檢測序列最后一位信號出現并且時鐘有效,檢測器才輸出檢測結果。經過對設計過程的分析和軟件仿真,造成該問題的原因是電路采用Mealy型設計方法,輸出受輸入和觸發器的狀態控制,輸入的變化即刻影響到輸出。本文提出一種摩爾型(Moore)的序列檢測器設計方法,輸出僅受觸發器的狀態控制,QuartusII軟件的仿真和實際的電路測試驗證了設計的有效性和輸出波形的合理。

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